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8段数码管静态显示Verilog设计逻辑Quartus工程源码文件
资料介绍
部分文件列表
文件名 | 大小 |
seg_led_static_top/ | |
seg_led_static_top/doc/ | |
seg_led_static_top/par/ | |
seg_led_static_top/par/db/ | |
seg_led_static_top/par/db/.cmp.kpt | |
seg_led_static_top/par/db/logic_util_heursitic.dat | 6KB |
seg_led_static_top/par/db/prev_cmp_seg_led_static_top.qmsg | |
seg_led_static_top/par/db/seg_led_static_top.(0).cnf.cdb | 2KB |
seg_led_static_top/par/db/seg_led_static_top.(0).cnf.hdb | 1KB |
seg_led_static_top/par/db/seg_led_static_top.(1).cnf.cdb | 2KB |
seg_led_static_top/par/db/seg_led_static_top.(1).cnf.hdb | 1KB |
... |
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资料:bitboy
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