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8段数码管静态显示Verilog设计逻辑Quartus工程源码文件

更新时间:2022-10-07 09:05:10 大小:3M 上传用户:铁蛋锅查看TA发布的资源 标签:数码管静态显示verilogquartus 下载积分:7分 评价赚积分 (如何评价?) 打赏 收藏 评论(0) 举报

资料介绍

8段数码管静态显示Verilog设计逻辑Quartus工程源码文件

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文件名大小
seg_led_static_top/
seg_led_static_top/doc/
seg_led_static_top/par/
seg_led_static_top/par/db/
seg_led_static_top/par/db/.cmp.kpt
seg_led_static_top/par/db/logic_util_heursitic.dat6KB
seg_led_static_top/par/db/prev_cmp_seg_led_static_top.qmsg
seg_led_static_top/par/db/seg_led_static_top.(0).cnf.cdb2KB
seg_led_static_top/par/db/seg_led_static_top.(0).cnf.hdb1KB
seg_led_static_top/par/db/seg_led_static_top.(1).cnf.cdb2KB
seg_led_static_top/par/db/seg_led_static_top.(1).cnf.hdb1KB
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