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16位运算器，用实例化模块链接，是采用Verilog hdl编程，是实现FPGA的代码
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16位运算器，用实例化模块链接，是采用Verilog hdl编程，是实现FPGA的代码
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| alu16位运算器/alu16.rar | 1132KB | 2013-11-20 00:01:32 |
| alu16位运算器/alu16位运算器.doc | 159KB | 2013-11-19 23:36:02 |
| alu16位运算器 | 1KB | 2013-11-20 00:01:46 |
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