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VHDL设计教程
资料介绍
HDL----Har dwar Description Language
一种用于描述数字电路的功能或行为的语言。目的是提为电路设计效率，缩 短设计周期，减小设计成本，可在芯片制造前进行有效的仿真和错误检测。
优点： HDL设计的电路能获得非常抽象级的描述。如基于RTL(Register Transfer Level)描述的IC，可用于不同的工艺。 HDL设计的电路，在设计的前期，就可以完成电路的功能级的验证。
HDL设计的电路类似于计算机编程。 常用的HDL语言：VHDL 、Ver ilog HDL VHDL是美国国防部在20世纪80年代初为实现其高速集成电路硬件VHSIC计划提出的描述语言; IEEE从1986年开始致力于VHDL标准化工作，融合了其它ASIC芯片制造商开发的硬件描述语言的优点，于93年形成了标 准版本（_1164）。 1995年，我国国家技术监督局推荐VHDL做为电子设计自动化硬件描述语言的国家标准。
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| 1554983760vhdl.pdf | 448K |
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