推荐星级:
  • 1
  • 2
  • 3
  • 4
  • 5

高速和资源节约型数据加密算法设计

更新时间:2019-09-01 20:17:29 大小:122K 上传用户:yuwei664查看TA发布的资源 标签:数据加密算法 下载积分:0分 评价赚积分 (如何评价?) 收藏 评论(1) 举报

资料介绍

高速和资源节约型数据加密算法设计

部分文件列表

文件名 大小
高速和资源节约型数据加密算法设计.pdf 122K

部分页面预览

(完整内容请下载后查看)
高速和资源节约型数据加密算法设计  
贺刚  
赵红言  
(空军工程大学 ,陕西西安 710051)  
来源:微计算机信息  
摘要 介绍3DES 数据加密算DDA原理对利FPGA 硬件实3DES 算法出  
了一种可进IP 核的具体设计思想用可重构电路节省器件内部资源采用有限状态机设计  
技术从而实现数据高速安全传输。本设计是ALTERA 公司Quartus II 环境下实现的,并成功  
下载到支持电路部分重构Xilinx Virtex II 系列器件中XC2V1500 芯片中。  
关键词 可进IP 核  
中图分类号:TP271+.5  
3DES  
FPGA 有限状态机  
文献标识号:A  
The design of DDA on adaptive IP core and FSM  
HeGang  
zhao hong-yan  
Airforce Engineering University, xi’ an, Shaanxi 710051,China)  
Abstract This paper introduces the theory of 3DES encrypt arithmetic, presents a detailed design  
idea of adaptive IP core Acording to using FPGA hardware to realize 3DES, adopt reconstituted circuit  
to save inner resource of chips, and adopt design method of finite-state machine(FSM),accordingly  
realize data transfer in a high speed and security way.This design realized in Quartus II condition of  
ALTERA Corporation,and successfully download to XC2V1500 chip.  
Keywords adaptive IP core  
3DES FPGA finite-state machine  
一、引言  
随着信息时代的到来息安全据传输快速在现代网络事通信等方面显得非常重要。  
因此对数据加密算法的改进很值得研究。传统的加密工作是通过加密软件实现的,此方法占用主  
机资源并且运算速度慢,安全性较差。采用硬件加密方式,是通过独立于主机系统外的硬件加密  
设备实现的,不占主机资源、速度快、安全性较高。DESdata encryption standard)算法是最为  
广泛使用的一种分组密码算法,已被证实是不安全的算法,在保持原有系统不做大的改动的前提  
下,研3DES 算法仍具有一定的实用价值。本文中利ALTERA 公司Quartus II 软件平台来  
开发用一FPGA 中可进IP 核设计思想和有限状态机设计方法成功下载Xilinx Virtex  
II 系列器件中XC2V1500 芯片中以实3DES 算法达到数据传输高效用资源少。  
二、设计原理  
13DES 数据加密算法原理  
DES 算法中数据64 位分组进行加密效密钥长度56 对明文进行初始置IP 后,  
16 轮的迭代密码,最后IP 的逆变换得到密文。每一轮的运算包含扩展置换、S 盒代换、P  
盒置换和两次异或运算,另外还有每一轮中还有一个子密钥。加密算法如图 13DES DES 为  
基本模块,通过组合分组方法设计出分组加密算法。3DES 具体实现为:  
加密过程为:C=EK3DK2EK1P))  
解密过程为:P=DK1EK2DK3C))  
Ek()Dk()DES 算法的加密和解密过程,K DES 算法的密钥,P 代表明文,  
C 代表密文。具体的加解密过程如图 2 所示。当三个密钥不同,本质上就相当于用一个长为 168  
位的密钥进行加密。  
2FPGA 中可进IP 核的一般结构及其实现  
从进化硬件的经验可知统通常只有一部分是可进化的使IP 核构造的系统也是  
有些 IP 核是可进化的。可进化 IP 核在被下载并放在一个可重构器件中后,它们将自动地进化它  
们的内部电路。核由可重构电路构成(本文中可重构电路是指可进化 IP 核内的一个部分基因  

全部评论(1)