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FPGA数字时钟完美通过测试
资料介绍
FPGA数字时钟完美通过测试。目标板是ZRTECH的EP2C5T144C8 CORE2-5U核心板及PERI1-8KD配套子卡
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| clock_test/clk_1Hz.v | 1KB | 2010-07-28 13:41:40 |
| clock_test/clk_1Hz.v.bak | 1KB | 2010-07-28 13:39:34 |
| clock_test/clk_1Hz.qpf | 1KB | 2010-07-26 20:44:50 |
| clock_test/clk_1Hz.qsf | 4KB | 2010-07-28 15:56:48 |
| clock_test/clk_1Hz.map.summary | 1KB | 2010-07-28 15:57:00 |
| clock_test/clk_1Hz.flow.rpt | 8KB | 2010-07-28 15:57:22 |
| clock_test/clk_1Hz.tan.rpt | 75KB | 2010-07-28 15:57:22 |
| clock_test/clk_1Hz.pin | 20KB | 2010-07-28 15:57:12 |
| clock_test/clk_1Hz.fit.smsg | 1KB | 2010-07-28 15:57:12 |
| clock_test/clk_1Hz.fit.summary | 1KB | 2010-07-28 15:57:12 |
| clock_test/clk_1Hz.cdf | 1KB | 2010-07-28 15:58:04 |
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