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FPGA时序优化的几种方法
资料介绍
衡量FPGA设计的两个重要指标是吞吐率和延迟。
吞吐率:指系统每一个时钟周期内能够处理的数据数量,为了获得更高的吞吐率就需要减少组合逻辑延迟,在组合逻辑中间插入寄存器,也就是流水线设计。
延迟:指数据从输入系统到输出系统总共需要的时间,为了获得更短的延迟,可以减少组合逻辑延迟,或者删减路径上的寄存器,第二种方法显然不利于系统获得更好的性能。
时序优化的几种方法
这里说的优化是让FPGA设计获得更高的工作频率,也就是通常说的性能和吞吐率。
1.插入寄存器(pipeline)
这种方式会增加设计的时滞(clock latency)。插入了几个寄存器,结果输出就会延长几个周期,在不违反设计规格(对clock latency有要求)以及功能没有影响的时滞情况之下可以这么做。举例说明,如果下面一个FIR滤波器的设计没能满足时序要求。
部分文件列表
文件名 | 大小 |
FPGA时序优化的几种方法.pdf | 418K |
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