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DDR3 IP核
资料介绍
DDR3高速IP控制核,里面包括仿真、IP示例程序,实现乒乓FIFO操作
部分文件列表
文件名 | 文件大小 | 修改时间 |
ddr3/.ddr3_fifo.vhd.un~ | 408KB | 2017-09-13 16:37:32 |
ddr3/.huanor_dcfifo_sah.vhd.un~ | 1KB | 2017-09-13 16:16:24 |
ddr3/ddr3/.ddr3_0002.v.un~ | 62KB | 2017-09-13 17:26:06 |
ddr3/ddr3/afi_mux_ddr3_ddrx.v | 9KB | 2017-09-14 11:34:28 |
ddr3/ddr3/altdq_dqs2_acv_cyclonev.sv | 59KB | 2017-09-14 11:34:28 |
ddr3/ddr3/altera_avalon_mm_bridge.v | 11KB | 2017-09-14 11:34:52 |
ddr3/ddr3/altera_avalon_packets_to_master.v | 51KB | 2017-09-14 11:34:52 |
ddr3/ddr3/altera_avalon_sc_fifo.v | 31KB | 2017-09-14 11:34:52 |
ddr3/ddr3/altera_avalon_st_bytes_to_packets.v | 7KB | 2017-09-14 11:34:52 |
ddr3/ddr3/altera_avalon_st_clock_crosser.v | 5KB | 2017-09-14 11:34:52 |
ddr3/ddr3/altera_avalon_st_idle_inserter.v | 2KB | 2017-09-14 11:34:52 |
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