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+2分并串/串并转换模块
资料介绍
采用verilog语言编写并串转换模块，有8位并串转换和16位并串转换代码。其中8位并串转换有a和b两种方法实现且b方法代码为并串转换和串并转换合在一起的代码。
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| BtoC/BtoC16.v | 1KB | 2017-10-17 14:20:16 |
| BtoC/BtoC16_tb.v | 1KB | 2017-10-17 14:23:16 |
| BtoC/BtoC8a.v | 1KB | 2017-10-17 14:20:02 |
| BtoC/BtoC8a_tb.v | 1KB | 2017-10-24 22:31:32 |
| BtoC/BtoC8b.v | 3KB | 2017-10-18 21:53:38 |
| BtoC/BtoC8b_tb.v | 1KB | 2017-10-18 21:54:16 |
| BtoC | 1KB | 2017-10-21 14:22:32 |
| Readme_download.txt | 1KB | 2017-11-16 16:01:04 |
| 使用说明更多帮助.html | 1KB | 2017-11-17 09:13:28 |
全部评论(1)
2021-12-31 11:34:1119506108863
很好的资源