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一个32位微处理器的verilog实现源代脉,采用5级流水线和cache技术.rar
资料介绍
一个32位微处理器的verilog实现源代脉,采用5级流水线和cache技术.rar
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| riscpu/1VERILOG.EXM | 141KB | 1995-08-29 18:35:58 |
| riscpu/2INTERPR.MOD | 93KB | 1995-08-21 21:12:56 |
| riscpu/3COARSE.MOD/01CHIP | 33KB | 1995-08-21 21:13:12 |
| riscpu/3COARSE.MOD/02IFU | 192KB | 1995-08-21 21:14:36 |
| riscpu/3COARSE.MOD/03IDU | 35KB | 1995-08-21 21:14:52 |
| riscpu/3COARSE.MOD/05MAU | 20KB | 1995-08-21 21:15:18 |
| riscpu/3COARSE.MOD/06FRU | 42KB | 1995-08-21 21:15:38 |
| riscpu/3COARSE.MOD/07PCU | 108KB | 1995-08-21 21:16:26 |
| riscpu/3COARSE.MOD/08BCU | 33KB | 1995-08-21 21:16:42 |
| riscpu/3COARSE.MOD/09SYST | 109KB | 1995-08-21 21:17:30 |
| riscpu/3COARSE.MOD/10SERV | 238KB | 1995-08-22 23:57:56 |
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